Sun Microsystems 最後の信者
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0001名無しさん＠お腹いっぱい。
2008/07/31(木) 20:17:31Sun Microsystems 最大の字余り
http://pc11.2ch.net/test/read.cgi/unix/1214127349/
0417名無しさん＠お腹いっぱい。
2008/08/28(木) 23:17:57言ってたジャン。
Sunの偉い人だっけね？
毎回遅れるのが定説なんだから…。
まぁ、涅槃がすぐそこだから、とんでもないことになるだろうけど。
0418名無しさん＠お腹いっぱい。
2008/08/29(金) 00:12:15Efficeonの不振は富士通のせいじゃない。
TransmetaのCPUの中では、富士通製造分は最も優秀だった。
最初のCrusoeが糞すぎただけなんだ。
あれでEfficeonが優れてると言われても誰ももう信じなかった。
ttp://pc.watch.impress.co.jp/docs/2003/1107/kaigai043.htm
> Transmetaは同社の使うプロセス技術とファウンドリ戦略も明らかにした。
> 「富士通で使うプロセスは、同社がASIC用に公開しているプロセスではない。
> HPEと内部で呼んでいる、SPARC64 プロセッサ向けとほぼ同じプロセスだ。
> 我々が使う彼らの90nmプロセスのトランジスタ(のゲート長)は、
> 90nmでも65nmでもなく、40nmだ。
> これは、非常に進んだ技術で、信じられないくらい速い。
この発言は
> 元Sun MicrosystemsでSPARCを担当していたDitzel氏
のもの。
0419名無しさん＠お腹いっぱい。
2008/08/29(金) 00:31:238コアと4コア
0420名無しさん＠お腹いっぱい。
2008/08/29(金) 00:36:370421名無しさん＠お腹いっぱい。
2008/08/29(金) 00:44:23Intelじゃあるまいし
0422名無しさん＠お腹いっぱい。
2008/08/29(金) 06:50:03VIAはこう言ってた
「どこでもよかったが富士通が安かった」
バリューセグメントの製品を高いファブで作ってもしょうがないと言うことらしい．
それ抜きにしても，，，富士通は異様に安く受注するので業界の癌みたいになってる．
マイクロが潰れそうだったからみたいなのだが．そこに同じく潰れそうな会社が群がる構図．
0423名無しさん＠お腹いっぱい。
2008/08/29(金) 08:38:49まあ営業力がVIAとTransmetaでは違いすぎるから
0424名無しさん＠お腹いっぱい。
2008/08/29(金) 12:32:32HPのMini-Note PCでのC7採用のおかげで、
後継のNanoが生まれる前から即死という最悪の自体は避けられたが。
0425名無しさん＠お腹いっぱい。
2008/08/29(金) 12:37:10というように結構入っているかもね
0426名無しさん＠お腹いっぱい。
2008/08/29(金) 12:38:15それでもTransmetaよりも数は出ているわけで
0427名無しさん＠お腹いっぱい。
2008/08/29(金) 17:21:43富士通電子デバイスとVIAの弱者連合でSPARCが救われる、なんてことがありえないのは
間違いない。
0428名無しさん＠お腹いっぱい。
2008/08/29(金) 18:08:36それ以前にTransmetaのCPUはくり返し処理以外は悲惨なスピードよ。
NetBurstなんか比較にならないほどのモッサリ。
>>427
それだけをもってしてSPARCを救うわけではないが、
SPARC64に何らかのメリットをもたらすだろう。
同時期に生産すればスケールメリットを、
交互に生産すれば生産ライン・技術の維持を。
0429名無しさん＠お腹いっぱい。
2008/08/30(土) 17:10:44富士通が一社でどうこうできるものではないはずだが。
0430名無しさん＠お腹いっぱい。
2008/08/31(日) 00:16:450431名無しさん＠お腹いっぱい。
2008/09/01(月) 02:15:29富士通が他所と組まないのは単独で出来るからか？違うと思う。
0432名無しさん＠お腹いっぱい。
2008/09/03(水) 00:44:000433名無しさん＠お腹いっぱい。
2008/09/03(水) 00:55:080434名無しさん＠お腹いっぱい。
2008/09/03(水) 01:52:04あの発言は、人ごとのように報道する朝日新聞に対する皮肉だよ。
実際、記者会見で質問した朝日の記者は、
「朝日新聞の○○です」と言うとき、
やたらと朝日のところを小さく不明瞭な発音でしていた。
それが記事になったとき案の定、
本紙記者の質問に対して、ではなく、
新聞記者の質問に対してって書いてあったからね。
朝日に踊らされちゃいかんよ。
0435名無しさん＠お腹いっぱい。
2008/09/03(水) 08:29:570436名無しさん＠お腹いっぱい。
2008/09/03(水) 15:04:390437名無しさん＠お腹いっぱい。
2008/09/03(水) 17:49:25OpenVMS on HP Integrity サーバ FAQ
ttp://h50146.www5.hp.com/products/software/oe/openvms/itanium/64bit_ext_faq.html
質問
AMD64 あるいは Xeon EM64T 上で OpenVMS が動作する予定はありますか？
いいえ。ありません。
-中略-
...優れた能力を備えた Itanium に注力するのが我々の方針です。
x86 は 64ビット拡張 (x86-64) により 8p までの拡張性を有することにはなりますが，
4p を越えたスケールで優れた性能を示すことはまだ実証されていません。
結果として，OpenVMS 環境で x86-64 を使用する利点は認められません。
改訂履歴：2004 年 7 月 翻訳
『4p を越えたスケールで優れた性能を示すことはまだ実証されていません。』
もう実証されたんだっけか? 4年経つしな?wwww
0438名無しさん＠お腹いっぱい。
2008/09/04(木) 03:27:39スレタイも読めない馬鹿は消えてくれ
>.437
Opteronの8ソケットがイマイチなのは有名だろ。
0439名無しさん＠お腹いっぱい。
2008/09/04(木) 09:58:47なにせほんの 4年前で「実証されてない」んだから、性能出てるんなら大ブレークスルー、だろ?
0440名無しさん＠お腹いっぱい。
2008/09/04(木) 11:46:47突然Core2を持ち出してきて何を言いたいのだ?
0441名無しさん＠お腹いっぱい。
2008/09/04(木) 11:55:061コアだけでなく、2コアでも4コアでも、
4ソケットまでは伸びるが、8ソケットは伸びないのよ。
0442名無しさん＠お腹いっぱい。
2008/09/04(木) 12:10:51勝手にねじ曲げといてしかも曲がらないやつ叩くとはたいした了見だな小学校出たか?
0443名無しさん＠お腹いっぱい。
2008/09/04(木) 12:52:060444名無しさん＠お腹いっぱい。
2008/09/04(木) 14:04:09「リニアに性能出てます」って記事はないの?
誰が買ってんの一体...w
0445名無しさん＠お腹いっぱい。
2008/09/04(木) 15:08:55437のどこに8コアなんて書いてあるの?
0446名無しさん＠お腹いっぱい。
2008/09/04(木) 15:14:590447名無しさん＠お腹いっぱい。
2008/09/04(木) 15:24:30しつこい粘着だ。
0448名無しさん＠お腹いっぱい。
2008/09/04(木) 16:04:424コアが1コアの4倍の性能を持つ必要は無いだろ。
0449名無しさん＠お腹いっぱい。
2008/09/04(木) 18:37:33TukwilaとSPARC64 VIIのチップサイズの違いはキャッシュサイズの違い。
EPIC/VLIWってシンプルなのかと思ってた。
0450名無しさん＠お腹いっぱい。
2008/09/04(木) 18:37:56その上位にクロスバー、ってパターン?
0451名無しさん＠お腹いっぱい。
2008/09/04(木) 18:59:12実は PA-RISC も入ってんじゃないか?w
0452名無しさん＠お腹いっぱい。
2008/09/05(金) 03:35:55Venusｷﾀ━━━━━━(ﾟ∀ﾟ)━━━━━━ｯ!!!
Itaniumの話はスレチだがコメントしておくと、EPICはシンプルではない。
レジスタウィンドウ、アウトオブオーダー実行、多数の実行ユニット
そして、そこらの投機実行とは違う、コンパイラによる投機コードの生成。
コアのトランジスタ数が膨大になって当然のアーキテクチャですよ。
0453名無しさん＠お腹いっぱい。
2008/09/05(金) 07:01:33IntelのLarrabeeの詳細
各コアの、
L1I$ 32KB
L1D$ 32KB
L2$ 256KB
っていう数字にはビックリだ。
0454名無しさん＠お腹いっぱい。
2008/09/05(金) 13:12:23あり得ないだろうが、Ultra25クラスに入ればいいおもちゃになりそうなんだが。
コンパイラも大変でCPUも複雑なら、RISCでいいんじゃなかろうか。
0455名無しさん＠お腹いっぱい。
2008/09/05(金) 13:17:34VLIW で長期互換を狙った EPIC はうまくいかなかった。
パイプライン効率にさえ配慮していない旧態の CISC は論外。
0456名無しさん＠お腹いっぱい。
2008/09/05(金) 13:35:09自問自答ですか。
0457名無しさん＠お腹いっぱい。
2008/09/05(金) 13:37:360458名無しさん＠お腹いっぱい。
2008/09/05(金) 14:07:440459名無しさん＠お腹いっぱい。
2008/09/05(金) 14:31:31Pentium×16コアでGPUになるなら、Niagaraもちょっと手入れればGPUだ。
ていうか、NiagaraがLarrabeeに喰われそうです。
0460名無しさん＠お腹いっぱい。
2008/09/05(金) 14:43:01おいおい。
> Larrabee、2010年のGPUにしては固定回路なさすぎだろう。
453の論文を斜め読みしたが、固定回路について結構な分量で触れてるよ。
> Pentium×16コアでGPUになるなら
なりません。
Pentiumとほぼ同じ命令セット + 専用のベクトル演算命令セット
なのであって、Pentiumと同じコアではないですよ。
> ていうか、NiagaraがLarrabeeに喰われそうです。
食われませんよ。
VenusとLarrabeeは一部で競合するかもしれないが。
0461名無しさん＠お腹いっぱい。
2008/09/05(金) 14:47:100462名無しさん＠お腹いっぱい。
2008/09/05(金) 15:00:01富士通はSPARC64を使ったスパコンを各所に納入している実績があるし、
京速スパコンのスカラ部分もSPARC64だっていう話だしさ。
> Venusは8コアを集積し、メモリコントローラもCPUチップに搭載する
> ペタスケールコンピューティングサーバ向けのCPUである。
> そして、プロセサコアは、SPARC V9仕様にHPC-ACEと呼ぶ
> SIMD拡張仕様を追加した命令アーキテクチャを持ち、
> ソケットあたりの演算性能は128GFlopsになるという。
一方、Larrabeeは現在のGPUより格段に柔軟性があり、
PPCカスタム+ローカルメモリをネットワークで繋いだスパコンに実績のあるアメリカでは、
Larrabeeを使ったスパコンも作られると思われるよ。
0463名無しさん＠お腹いっぱい。
2008/09/05(金) 15:09:04チップが競合するってのは違和感ある
0464名無しさん＠お腹いっぱい。
2008/09/05(金) 16:34:48VenusとLarrabeeが競合とかわけのわからない事を言われる始末。
0465名無しさん＠お腹いっぱい。
2008/09/05(金) 17:03:14Sunは
ttp://signalspot.com/OpenSPARC_T2_presentation_day_1.pdf
> Customers can choose between Sun UltraSPARC T2,
> Intel Xeon / AMD Opteron quad-core processors
って書いてるけど、シャーシあたり768プロセッサってことは、
ブレードあたり4プロセッサを搭載しないといけないわけだが、
Victoria Fallsの4プロセッサ構成はまだリリースできてない。
ちなみに、テキサス大学のTACCはOpteronを選択した模様。
0466名無しさん＠お腹いっぱい。
2008/09/05(金) 20:33:45Xeonなら2Pと4P、Opteronなら2Pがあるのに。
8000用のブレードでは、XeonとOpteronのみで、T1、T2すらない。
やる気あるのかよ、Sun。
0467名無しさん＠お腹いっぱい。
2008/09/05(金) 21:27:100468名無しさん＠お腹いっぱい。
2008/09/05(金) 23:45:23だろうねえ
0469名無しさん＠お腹いっぱい。
2008/09/06(土) 03:02:26やる気と才能のある連中はとっくに辞めてるだろ
0470名無しさん＠お腹いっぱい。
2008/09/06(土) 10:11:460471名無しさん＠お腹いっぱい。
2008/09/06(土) 10:28:38ソケットあたりの性能ではx86を凌駕してるぞ。
ベンチマークでも世界一のスコアを叩き出してる。
問題はx86と同じソケット数のサーバやブレードをSunが出さないことだ。
なんか高く売ろうとして出し惜しみしてるんじゃないか? つまらない考えだ。
SMP対応してなくたっていいから、1Uあるいは1ブレードに4台分を押し込め。
自慢の消費電力の低さなのだから、爆熱のXeonやOpteron4発のスペースに4個入るだろ?
0472名無しさん＠お腹いっぱい。
2008/09/06(土) 16:35:37T2+の1チップあたりの消費電力はXeon/Opteronより嵩むんでつ。
ポラックの法則で、小さなコアを集積すれば消費電力あたりの性能は増えるけど、
そこから先、設計やら製造やらでの消費電力を下げる地道な努力の部分で負けてるから、
かなり相殺されちゃってるんじゃないですかねえ……
もういっそARM集積しちゃいなYO!
0473名無しさん＠お腹いっぱい。
2008/09/06(土) 16:44:27どうせLDomを使うんだから4ソケット鯖と1ソケット鯖4つ分の違いは、それほど問題じゃないだろ。
0474名無しさん＠お腹いっぱい。
2008/09/06(土) 17:04:45> SIMDは4積和演算を行うもので，クロックは2GHzと考えられます。
SPARC64VIIIはSIMD積むかわりに周波数は落とすんだな。
やっぱり電力が厳しいのかなあ。
0475名無しさん＠お腹いっぱい。
2008/09/06(土) 19:13:590476名無しさん＠お腹いっぱい。
2008/09/06(土) 19:18:540477名無しさん＠お腹いっぱい。
2008/09/06(土) 19:25:353ページ目に、ROCK 2.0 in Lab today ってあるから、
やっぱりテープアウトやり直しをしたんだな。
0478名無しさん＠お腹いっぱい。
2008/09/06(土) 19:33:5364CPUとかのモンスターマシンは出てこないの?
0479名無しさん＠お腹いっぱい。
2008/09/06(土) 20:55:550480名無しさん＠お腹いっぱい。
2008/09/07(日) 05:29:350481名無しさん＠お腹いっぱい。
2008/09/07(日) 07:10:150482名無しさん＠お腹いっぱい。
2008/09/07(日) 20:02:59インテルのPentiumProとPentiumIIのSMPには欠陥があった。
マイクロソフトは、使い物にならないと判断し、
2003からは強制的に1CPUで動作させるようにした。
ttp://support.microsoft.com/kb/319091/EN-US/
Windows2003の問題点であってNT4や2000ではSMP動作する!
なんてアホなことを抜かしている人がいたが、そういう問題じゃあない。
酷い話だよ。
0483名無しさん＠お腹いっぱい。
2008/09/07(日) 22:00:210484名無しさん＠お腹いっぱい。
2008/09/07(日) 22:28:150485名無しさん＠お腹いっぱい。
2008/09/07(日) 22:55:31あれってPentiumII世代だよな?結構ユーザー居るんじゃないの？
0486名無しさん＠お腹いっぱい。
2008/09/07(日) 23:06:330487名無しさん＠お腹いっぱい。
2008/09/07(日) 23:12:27http://journal.mycom.co.jp/articles/2008/09/06/hotchips6/index.html
これで消費電力がせめて150Wだったらなあ
0488名無しさん＠お腹いっぱい。
2008/09/07(日) 23:28:25趣味のレベルで話されてもなぁ。
オモチャのレベルで良けりゃ何の問題もないエラッタだよ。
0489名無しさん＠お腹いっぱい。
2008/09/08(月) 00:04:47買うのか？
0490名無しさん＠お腹いっぱい。
2008/09/08(月) 01:07:11サーバ全体の消費電力をパフォーマンスで割ったものだけでいい。
0491名無しさん＠お腹いっぱい。
2008/09/08(月) 05:49:41犠牲にしているし、スループット指向にしてはout-of-orderや投機実行で電力性能比を
悪化させている。キャッシュ接続の都合で当分は2プロセッサ構成に制約されるし、
250Wは明らかに常軌を逸している。
Niagaraに比べると、軸がブレている感が。これは誰が嬉しいチップなんだ?
0492名無しさん＠お腹いっぱい。
2008/09/08(月) 08:20:28なんか歪だよね。
ソフトのライセンス対策で無理やり1ソケットのコア数を増やしました、って感じ。
2チップ構成になるとしても、
16コアのダイ + L3キャッシュ&メモリコントローラのダイ
ではなく
8コアでL3キャッシュ&メモリコントローラも持つダイを2つ
という構成にすれば良かったのに。
0493名無しさん＠お腹いっぱい。
2008/09/08(月) 11:37:21デュアルまでのT2+といい、今のSunは4つ以上繋ぐのが苦手なのかね?
0494名無しさん＠お腹いっぱい。
2008/09/08(月) 11:53:26他のダイとの接続には非常に多くの面積を必要とする。
トランジスタだけでなくピンに配線するためのパッドも面積を食う。
パッケージのピン数も限りがある。
だから、メモリコントローラとダイ間接続の両方を持つのは無理。
(メモリコントローラもまた、非常に多くの面積を必要とする。)
どうせメモリコントローラを別ダイにするのであれば、
クロスバーの容量を考えたら、8コア2つよりも16コア1つのほうが有利。
そういうわけで、Rockのデザインは合理的だ。
ただし、8コア×2ダイと16コア×1ダイの比較においては。
8コア×1ダイ(メモコン内臓)と16コア×1ダイ(メモコン外付け)の比較なら、
欲張らずに前者で妥協したほうがよかったかもしれない。
Niagara2にスループットで負けるかもしれんが。
0495名無しさん＠お腹いっぱい。
2008/09/08(月) 11:56:48Niagara系は1Uや2Uのサーバをターゲットにしているから、1〜4CPU止まりでOKだが、
Rockはミッドレンジやハイエンドもターゲットにしてるんでしょ? 当然。
そうでなかったら、E25Kの後継機はないってことになっちゃうもの。
0496名無しさん＠お腹いっぱい。
2008/09/08(月) 12:21:530497名無しさん＠お腹いっぱい。
2008/09/08(月) 15:55:260498名無しさん＠お腹いっぱい。
2008/09/08(月) 16:04:170499名無しさん＠お腹いっぱい。
2008/09/08(月) 16:22:19250Wの冷却は高価すぎる。
0500名無しさん＠お腹いっぱい。
2008/09/08(月) 18:19:22むしろローエンドだからこそ低廉化のために集積度が求められるんじゃないかな。
Niagara初代および2は、ワンチップにすべてを入れることにこだわって作られたよね。
0501uurmt
2008/09/08(月) 18:55:14本当に感心しちゃうね。
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0502名無しさん＠お腹いっぱい。
2008/09/08(月) 22:36:18SPARCに限らず存在しなかったと記憶しているのだが。
0503名無しさん＠お腹いっぱい。
2008/09/08(月) 22:38:530504名無しさん＠お腹いっぱい。
2008/09/08(月) 23:13:000505名無しさん＠お腹いっぱい。
2008/09/08(月) 23:35:27Sunはいったい何考えてんだよ・・・怖ぇー
0506名無しさん＠お腹いっぱい。
2008/09/09(火) 00:19:53何が？ What part ?
0507名無しさん＠お腹いっぱい。
2008/09/09(火) 01:32:15http://www.eetimes.com/news/latest/showArticle.jhtml?articleID=210600141
0508名無しさん＠お腹いっぱい。
2008/09/09(火) 01:55:00Itanium2はもう少し低いようだ。
あと他に電力喰いのCPUとは?
0509名無しさん＠お腹いっぱい。
2008/09/09(火) 09:37:24> この16個のコアを製造可能なチップサイズに搭載し、かつ、空冷で冷却でき
> る最大電力と言う要件から、コアサイズは15平方mm以下、コアの消費電力は
> 10Wかそれ以下という制約のもとで最高の性能を実現するコアを考えたとい
> う。
空冷で冷やせるらしい。
なんとなくこんな話を妄想した。
A: ヘイ、16コアのCPUは、1コアあたりの最大消費電力をどれくらいにすればいいんだい?
B: (1チップ150Wとして、16で割れば……)10Wくらいかな
A: OK。
...後日...
A: ヘイ、イカしたチップが出来たぜ。1コアあたり10W、チップ全体では250Wに収まったぜhehe
B: 冷やせねーよ!
0510名無しさん＠お腹いっぱい。
2008/09/09(火) 10:14:14Niagara2とVictria Fallsを比較すると、
消費電力は84Wと123W。約40Wアップ。
FB-DIMM対応のメモリコントローラを半減
10GbEを2本とも削除
PCI-Express x8を倍増
Coherence & Link Controller追加
Serial System Interface追加
この変更で40Wアップですよ。
外部との接続に電気を食うんだ。
0511名無しさん＠お腹いっぱい。
2008/09/09(火) 14:21:350512名無しさん＠お腹いっぱい。
2008/09/09(火) 14:27:26たしかに延びるのはイタいな。
Niagara 以降 3点が素早く出ただけに余計。
0513名無しさん＠お腹いっぱい。
2008/09/09(火) 14:29:128MB のキャッシュ積んだのと同等、とあったが、それくらいの違いだと
Intel 物量で可能だったりする...
0514名無しさん＠お腹いっぱい。
2008/09/09(火) 16:30:19の予想は的中。
>>305
は自分で言ったことが自分に跳ね返ってくるタイプ。
0515名無しさん＠お腹いっぱい。
2008/09/09(火) 16:39:49インテルは物量作戦で、L3キャッシュを積む代わりにL2キャッシュを大容量にしちゃうからなぁ。
0516名無しさん＠お腹いっぱい。
2008/09/09(火) 16:51:26SRAM増やしてもロジック増やしても解決する問題なら、
SRAM増やす方がどう考えてもまっとうですがな。
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