Sun Microsystems 最大のリストラ
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0001名無しさん@お腹いっぱい。
2006/06/05(月) 14:32:59【前スレ】
Sun Microsystems 最大の重複
http://pc8.2ch.net/test/read.cgi/unix/1141840635/
0596名無しさん@お腹いっぱい。
2006/08/31(木) 00:25:14ttp://www.spec.org/cpu2000/results/res2006q3/cpu2000-20060710-06448.html
Fujitsu Siemens Computers PRIMERGY RX600 S3, Intel Xeon processor 7140M, 3.40 GHz 162
ttp://www.spec.org/cpu2000/results/res2006q3/cpu2000-20060807-06940.html
7041と7140Mと比べてクロック比以上に7140Mが早いのは何でだろうと考えてみたが
7040Mは16MBのL3キャッシュがオンチップで載ってるんだな
x86に16MBのL3キャッシュがオンチップで搭載されるとはすごい時代だな
0597名無しさん@お腹いっぱい。
2006/08/31(木) 00:29:30取締役会に出るだけだろ。取締役はいっぱいいる。
0598名無しさん@お腹いっぱい。
2006/08/31(木) 00:34:08> x86に16MBのL3キャッシュがオンチップで搭載されるとはすごい時代だな
つーか、Core 2 のアドバンテージはキャッシュの効きが全てだ、という分析をしてる人もいる。
0599名無しさん@お腹いっぱい。
2006/08/31(木) 00:41:05PRIMERGY RX300 S3, Intel Xeon 5160 processor, 3.0 GHz 4 cores, 2 chips, 2 cores/chip 121
ttp://www.spec.org/cpu2000/results/res2006q3/cpu2000-20060721-06564.html
Advanced Micro Devices
Tyan Thunder K9QE (S4985) AMD Opteron (TM) 2220SE 4 cores, 2 chips, 2 cores/chip 78.3
http://www.spec.org/cpu2000/results/res2006q3/cpu2000-20060721-06570.html
2chipだと圧倒的にXeonの方が早いね
0600名無しさん@お腹いっぱい。
2006/08/31(木) 01:55:170601名無しさん@お腹いっぱい。
2006/08/31(木) 02:32:370602名無しさん@お腹いっぱい。
2006/08/31(木) 23:48:38ttp://japan.cnet.com/news/ent/story/0,2000056022,20218367,00.htm
早くTIと手を切らないとROCKが出るまで会社が持たないんじゃないの。
0603名無しさん@お腹いっぱい。
2006/09/01(金) 00:21:380604名無しさん@お腹いっぱい。
2006/09/01(金) 00:36:240605名無しさん@お腹いっぱい。
2006/09/01(金) 00:57:35Intelの格差は縮まらない気ガス。
富裕層のIBMは低所得者層に落ちたサムを眺めてる感じか?
0606名無しさん@お腹いっぱい。
2006/09/01(金) 01:03:19製造プロセスの進展とキャッシュの強化で AMD の現状コアは十分 Core2 に対抗可能。
インターコネクトとシステムトータルでは Intel のはもう寿命。
0607名無しさん@お腹いっぱい。
2006/09/01(金) 01:16:31歩留まりが悪い、といった場合、やっぱ製造側が悪いの? 設計じゃなくて?
TI って、45nm の製造プロセス実現したって発表してるのに、なんで 90nm ごときで
こうも遅れたりするのか...
0608名無しさん@お腹いっぱい。
2006/09/01(金) 01:50:28設計が悪い場合と製造が悪い場合と両方ある
0609名無しさん@お腹いっぱい。
2006/09/01(金) 02:42:11Op厨必死だなw
0610名無しさん@お腹いっぱい。
2006/09/01(金) 12:03:490611名無しさん@お腹いっぱい。
2006/09/01(金) 16:39:39Intelは65nmでこけるとか言っておきながら実際に電圧下げられずにこけそうなのはAMD
サーバではOpteronの方が有利といっておきながらWoodcrestに惜敗
すがるのはGhz競争やx64やNetburstなどの過去の栄光のみ
0612名無しさん@お腹いっぱい。
2006/09/01(金) 16:56:59tulsa もさぁ、すぐ次が見えてて、しかもそいつもツギハギニコイチで、誰が買うのあんなもん?www
0613名無しさん@お腹いっぱい。
2006/09/01(金) 17:28:00IIIi+ の性能向上がたいしたことなかった、って書いてあるのもあるね。
0614名無しさん@お腹いっぱい。
2006/09/01(金) 17:32:28ttp://japan.cnet.com/news/biz/story/0,2000056020,20219287,00.htm
Intelは世界各国に約10万人の従業員を抱えている。今回の人員削減は、同社従業員の
実に10%に及ぶ可能性がある。
先般の値下げが自分の首を絞める結果になったか?
0615名無しさん@お腹いっぱい。
2006/09/01(金) 17:55:07MCMでコストと性能の両立計るなんてIntelじゃなくてもやってること。
先日IBMがQuadCoreのPower5+を発表したのは記憶に新しい。
結局生産力が足りないのか技術力が無いのか知らないけど、自社の無能を曝け出しただけ。
0616名無しさん@お腹いっぱい。
2006/09/01(金) 18:01:03ひっくり返した直後だし、採用に二の足踏まれる状況が続くんじゃない? 当分苦戦だね。
0617名無しさん@お腹いっぱい。
2006/09/01(金) 18:35:010618名無しさん@お腹いっぱい。
2006/09/01(金) 19:01:52TIやる気なさそうだし。安いのはAMDでカバーっていうか、AMDよりIntelの方が
安くなればIntelでもいいかも知れん。でも、DellもAMDをやるっていうのは、
やっぱ4CPU以下はIntelじゃ儲からんってことよね、コンピュータ会社からしたら。
0619名無しさん@お腹いっぱい。
2006/09/01(金) 22:26:110620名無しさん@お腹いっぱい。
2006/09/02(土) 00:49:34>>576
>>579
0621名無しさん@お腹いっぱい。
2006/09/02(土) 01:16:390622名無しさん@お腹いっぱい。
2006/09/02(土) 09:42:04>>423
> 「キャッシュのコヒーレンシプロトコルと連携したロックのための機構」
wikipediaのItanium2のページには
> L2キャッシュがALUを使わずにセマフォーを操作できるロジックを備えている
なんて書いてあるよ。
0623名無しさん@お腹いっぱい。
2006/09/02(土) 12:26:19わかってない香具師多すぎ。
性能、可用性、将来性共に劣るオプをメインに据えるからには、それなりの理由がある。
0624名無しさん@お腹いっぱい。
2006/09/02(土) 15:42:37塩送りたくないだけだよ。ほんとは SPARC にがんばってほしい。
Niagara2 と Rock で奥歯ガタガタいわしてやるから待ってろw
0625名無しさん@お腹いっぱい。
2006/09/02(土) 17:52:310626名無しさん@お腹いっぱい。
2006/09/02(土) 19:00:58劣るってのは SPARC に対してだろ? Intel 石は AMD よりずっと劣ってるからなw
0627名無しさん@お腹いっぱい。
2006/09/02(土) 19:16:450628名無しさん@お腹いっぱい。
2006/09/02(土) 19:17:370629名無しさん@お腹いっぱい。
2006/09/02(土) 20:14:33Intelのamd64(x86_64って言ったほうがいいかな?)は……だし
ia64は……どうするつもりなんだろうねぇ……
もういいかげん本気にならないとまずいんじゃないの?
0630名無しさん@お腹いっぱい。
2006/09/02(土) 20:19:29変なエラッタもあるみたいだけど
SSE高速化の恩恵を受けるアプリケーション使ってるならC2D買うメリットあるんじゃない
0631名無しさん@お腹いっぱい。
2006/09/02(土) 21:10:210632名無しさん@お腹いっぱい。
2006/09/02(土) 23:47:49SPECなんちゃらだと、やっぱり信用できない。
0633名無しさん@お腹いっぱい。
2006/09/03(日) 01:22:53IntelのAMD64互換命令セットは、Intel64と命名されました
0634名無しさん@お腹いっぱい。
2006/09/03(日) 04:22:230635名無しさん@お腹いっぱい。
2006/09/03(日) 10:52:030636名無しさん@お腹いっぱい。
2006/09/03(日) 12:11:51そうなの?Intel64ってやめちゃったの?
0637名無しさん@お腹いっぱい。
2006/09/03(日) 12:56:38既存アプリとの互換性を唱って、T1にもRockまでの繋ぎの役目を持たせた為に
製品としては中途半端な出来上がりに成ってしまいました。
0638名無しさん@お腹いっぱい。
2006/09/03(日) 16:14:30ttp://www.opensparc.net/pubs/preszo/06/HotChips06_09_ppt_master.pdf
インテルのCore2は、SSE2が2倍速になったのが大きい。
(そもそも、それまでが1/2倍速動作だったのが、おかしいのだが・・・)
0639MACオタ>638 さん
2006/09/03(日) 17:36:05ここにも貼りに来たすけど,転載済みすか(笑)
0640名無しさん@お腹いっぱい。
2006/09/03(日) 17:39:08久しぶりにMACオタを見たw
近頃はどの辺に出没してるんですか?
0641名無しさん@お腹いっぱい。
2006/09/03(日) 19:24:14巣に帰れよ
0642名無しさん@お腹いっぱい。
2006/09/04(月) 00:07:43やっぱ 2 ソケット構成は見送られたんだな.. 書いてない。
0643名無しさん@お腹いっぱい。
2006/09/05(火) 00:38:250644名無しさん@お腹いっぱい。
2006/09/05(火) 07:51:54WebやWebAP、メールなど。
0645名無しさん@お腹いっぱい。
2006/09/05(火) 13:01:40CPU2000のCFP RateのPeak(笑)とか極一部を除いて
Niagara2もSMP非対応じゃSPARCはもう死んだか?
0646名無しさん@お腹いっぱい。
2006/09/05(火) 15:00:25オマエは何をいっているんだ?
0647名無しさん@お腹いっぱい。
2006/09/05(火) 16:31:50このスレにはいろんな人がやってきますね。
0648名無しさん@お腹いっぱい。
2006/09/05(火) 18:08:21オマエも CPU の価値を総ナメしてるよ。
0649名無しさん@お腹いっぱい。
2006/09/05(火) 20:21:46もうOpteronでいいじゃん
0650名無しさん@お腹いっぱい。
2006/09/05(火) 21:28:08DDR2 4ch だから、Niagara って Opteron の倍のバンド幅があるのでは?
0651名無しさん@お腹いっぱい。
2006/09/05(火) 23:27:270652名無しさん@お腹いっぱい。
2006/09/05(火) 23:29:240653名無しさん@お腹いっぱい。
2006/09/05(火) 23:46:03コア数を増やすと(TLP偏向だと)演算能力はどんどん上げられるがメモリのバンド幅は増やせない。
FB-DIMM採用すればよかったかも。
消費電力の問題があるからNiagaraの存在意義が疑われかねないけど。
0654名無しさん@お腹いっぱい。
2006/09/05(火) 23:50:26Athlon 64 が DDR から DDR2 でメモリバンド幅が倍になっても、
ベンチマークは数%向上するかしないか程度しか違いがなかった
わけで。
サーバ用途だと、比較的メモリバンド幅は重要だけど、Niagara
が足りてないとは思えん。というか、もし Niagara で足りてない
なら、Xeon や Opteron は破滅。
0655名無しさん@お腹いっぱい。
2006/09/06(水) 00:06:000656名無しさん@お腹いっぱい。
2006/09/06(水) 02:08:220657名無しさん@お腹いっぱい。
2006/09/06(水) 03:43:21>演算能力が高ければ高いほど必要なメモリバンド幅は上がる。
>コア数を増やすと(TLP偏向だと)演算能力はどんどん上げられるがメモリのバンド幅は増やせない。
Opteronと比べると相対的にデータの供給能力は下がっているってことでしょ
0658名無しさん@お腹いっぱい。
2006/09/06(水) 05:52:18Niagara 1.2GHz × 8 コア = 9.6 [GHz・コア]
だから、周波数×コア数換算だと 9.6/6.0=1.6倍くらいでしょ。
メモリバンド幅は2倍だから、むしろ Opteron よりもデータ供給能力は
改善してるような。
実際には Opteron は 3 issue/clock なのにたいし、Niagara は 1 issue/clock
なので、演算器数あたりのメモリバンド幅だったら、さらに Niagara の方が良い。
0659名無しさん@お腹いっぱい。
2006/09/06(水) 07:15:54benchmark users 1,966 SD
ttp://www.sap.com/solutions/benchmark/pdf/cert6306.pdf
HP ProLiant DL585 G2 AMD Opteron processor 8220SE
benchmark users 1,978 SD
ttp://www.sap.com/solutions/benchmark/pdf/cert6706.pdf
0660名無しさん@お腹いっぱい。
2006/09/06(水) 23:36:230661名無しさん@お腹いっぱい。
2006/09/06(水) 23:39:280662名無しさん@お腹いっぱい。
2006/09/07(木) 02:36:220663名無しさん@お腹いっぱい。
2006/09/09(土) 06:56:59ClovertownのDPでとどめ刺されるんじゃないの。
0664名無しさん@お腹いっぱい。
2006/09/09(土) 11:39:420665名無しさん@お腹いっぱい。
2006/09/09(土) 11:42:180666名無しさん@お腹いっぱい。
2006/09/09(土) 11:51:050667名無しさん@お腹いっぱい。
2006/09/09(土) 12:04:430668名無しさん@お腹いっぱい。
2006/09/09(土) 12:50:240669名無しさん@お腹いっぱい。
2006/09/09(土) 15:18:430670名無しさん@お腹いっぱい。
2006/09/09(土) 17:28:29http://blue.ap.teacup.com/kaz622/20.html
0671名無しさん@お腹いっぱい。
2006/09/09(土) 18:39:24http://tweakers.net/reviews/646/
勝負にならなかったw
0672名無しさん@お腹いっぱい。
2006/09/09(土) 22:50:14ぶっちぎりってわけでもないんだね。
UltraSparc T1も出てるねw
0673名無しさん@お腹いっぱい。
2006/09/09(土) 23:21:180674名無しさん@お腹いっぱい。
2006/09/09(土) 23:22:56http://japan.zdnet.com/news/hardware/story/0,2000056184,20225067,00.htm
0675名無しさん@お腹いっぱい。
2006/09/09(土) 23:31:040676名無しさん@お腹いっぱい。
2006/09/10(日) 02:17:33来年に65nmプロセスに本格的に移行するようだがそれまではIntelの一人がちだろうな
0677名無しさん@お腹いっぱい。
2006/09/10(日) 02:40:430678名無しさん@お腹いっぱい。
2006/09/10(日) 03:24:470679名無しさん@お腹いっぱい。
2006/09/10(日) 04:00:060680名無しさん@お腹いっぱい。
2006/09/10(日) 10:33:450681名無しさん@お腹いっぱい。
2006/09/10(日) 12:28:04NiagaraはWeb Centricだからいじめないでね、って書いてあるじゃん。
ttp://www.sun.com/products-n-solutions/edu/events/2006/erc/presentations/david_yen.pdf
0682名無しさん@お腹いっぱい。
2006/09/10(日) 15:14:100683名無しさん@お腹いっぱい。
2006/09/10(日) 16:23:060684名無しさん@お腹いっぱい。
2006/09/10(日) 17:12:120685名無しさん@お腹いっぱい。
2006/09/10(日) 22:43:17ttp://www.theinquirer.net/default.aspx?article=34263
0686名無しさん@お腹いっぱい。
2006/09/10(日) 22:44:11今週のあんどーさんとこ読んでみな。Intel のまっとうなプロセッサインターコネクトが
でてくるのは 2008 年。焼き直しでそこまでつなぐのは Intel。その間プロセスの向上で
性能が上がるのは AMD の方。
0687名無しさん@お腹いっぱい。
2006/09/10(日) 22:55:30全く向かないって、最初から言われてたのに…
にも関わらず、その Niagara にさえ、性能電力比で負ける NetBurst
(Dempsey) っていったい…
65nm 使ってて、90nm に負けてるってところも恥ずかしいですね。
0688名無しさん@お腹いっぱい。
2006/09/10(日) 23:17:040689名無しさん@お腹いっぱい。
2006/09/10(日) 23:42:140690名無しさん@お腹いっぱい。
2006/09/10(日) 23:52:53Canelandが出るから4ソケットまでなら新型のシリアルバスはコストの面でしか従来のQDRバスに勝る点はないことになるのでは?
つか旧型バスでもMerom並にリッチなコアを倍々で増やされると苦しい
0691名無しさん@お腹いっぱい。
2006/09/10(日) 23:57:22IntelはメモリI/F、周辺I/OがSerial化されるタイミングでFSBのSerial化を考えてる訳で
別におかしなやり方とは思わないが。
AMDが65nm processを軌道に載せた頃には恐らくIntelは45nm processを立ち上げてる。
processで先行できず、斬新なCore Architectureの投入が出来ないAMDに先はない。
0692名無しさん@お腹いっぱい。
2006/09/11(月) 00:45:50インターコネクトも設計はできるがチューニングはできんよ。やつらシロートだし、
Intanium 周辺でそのあたりできたやつはもう追い出しちゃったし。
0693名無しさん@お腹いっぱい。
2006/09/11(月) 00:49:3145nmプロセスを立ち上げた後は?
常に技術的に優位に立とうとしても物理的な限界もあるからな
半導体技術はあと数年で物理的な限界に突入する
0694名無しさん@お腹いっぱい。
2006/09/11(月) 00:51:05少し前に Intel が言ってた通りならもう限界に到達してるはずwwww
0695名無しさん@お腹いっぱい。
2006/09/11(月) 00:56:27Intelによれば8nmまでは行くようだけど
IDF Spring 2004 - 2017年には8nmノードに? Intelプロセスロードマップ
http://journal.mycom.co.jp/articles/2004/02/19/idf2/
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